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LoRD, 게이트레벨 트로이목마 탐지 — 휴리스틱으로 ML급 성능

Semiconductor Engineering2026-09-211분 읽기영문 원문
분야 자료 사진 — 칩 다이의 회로 배치 · Martijn Boer · 퍼블릭 도메인 (기사 원문의 사진이 아닙니다)

위스콘신-매디슨대와 매리스트대 연구진이 'Demystifying Gate-Level Localization of RTL Trojans'라는 논문을 발표했다. 연구진은 RTL 트로이목마가 합성 이후에도 구조적·신호흐름 패턴을 안정적으로 유지한다는 점에 착안해, 범용 머신러닝 기반 특징 학습 대신 타깃형 휴리스틱으로 탐지하는 LoRD 기법을 제안했다. LoRD는 이러한 서브그래프 시그니처를 활용해 콘테스트 테스트케이스에서 거의 완벽한 탐지·위치추정 성능을 보였다. 트랜스포머 기반 ML 베이스라인 및 상위 5개 팀과 비교했을 때, LoRD는 데이터·튜닝 부담 없이 트로이목마 삽입 설계에 대해 평균 3점 만점에 2.957점을 기록했다.

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이 글은 원문을 요약한 큐레이션입니다. 제목은 요약에 맞춰 새로 붙였습니다. 수치와 단위는 원문 표기를 유지했습니다. 전체 내용은 원 매체에서 읽어 주세요.원문: Semiconductor Engineering 「Detecting Hardware Trojans in Synthesized Gate-Level Netlists (UW-Madison, Marist)」

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전체 뉴스

아라산, 타이베이서 SWI3S 첫 시연 — 모바일·차량용 IP코어 공개

아라산 칩 시스템즈가 2026년 10월 21일 타이베이에서 열리는 MIPI 회원사 모임에서 업계 최초로 MIPI SWI3S 매니저 및 주변장치 IP를 시연한다고 밝혔다. 아라산은 모바일 및 자동차 SoC를 위한 반도체 IP 코어를 제공하는 업체다. 본사는 캘리포니아 산호세에 있으며, 해당 SWI3S IP는 22나노미터 이하의 다양한 파운드리 노드에서 이용할 수 있다고 회사 측은 설명했다.

KIPOST2026-09-30

이매지네이션 E-Series GPU, 엣지용 그래픽·AI 통합 아키텍처

이매지네이션테크놀로지스가 2025년 공개한 E-Series GPU IP는 그래픽, 컴퓨트, AI 연산을 하나의 아키텍처와 소프트웨어 스택으로 묶은 엣지용 GPU IP다. 1GHz 기준 코어당 최대 32 TOPS(Int8) 성능을 내며, 이는 D-Series 대비 4배 높은 연산 성능이라고 밝혔다. 그래픽과 AI 워크로드를 동시에 처리할 수 있어 전용 AI 프로세서의 피크 부하를 분담하는 코프로세서로도 쓸 수 있다. 첫 실리콘은 2026년 말 나올 예정이며, 게이밍·뉴럴 렌더링·언어모델 등에서의 성능 데이터도 함께 공개됐다.

Semiconductor Engineering2026-09-30

Rambus CryptoManager, Caliptra 표준 상용화 지원

Semiconductor Engineering이 소개한 백서는 오픈소스 루트오브트러스트 프레임워크 Caliptra가 데이터센터·AI 인프라의 이기종 프로세서와 가속기, 컨트롤러에 대한 기기 신원, 측정 부트, 원격 증명(attestation)의 공통 기반으로 자리잡고 있다고 설명한다. 백서는 오픈소스 표준을 인증 가능한 상용 수준 배포로 전환하는 과정의 과제를 다룬다. 이어 Rambus의 CryptoManager Root of Trust가 Caliptra 사양과 함께 사용되며 Caliptra 생태계 정합성과 상표를 유지하면서 SoC 전반으로 신뢰를 확장하는 방식을 설명한다.

Semiconductor Engineering2026-09-30

AI SoC 인터페이스 IP, PCIe·HBM·CXL 검증 전략 백서

반도체 전문매체 Semiconductor Engineering이 AI SoC의 PCIe, CXL, 이더넷, HBM, USB, UFS 등 인터페이스 검증을 다룬 백서를 소개했다. 백서는 인터페이스 IP와 PHY 통합, 검증 IP가 프로토콜 준수와 상호운용성 확보에 필수적이라고 설명한다. 에뮬레이션·프로토타이핑 기반 하드웨어 지원 검증이 실리콘 이전 단계에서 드문 프로토콜 오류와 장시간 결함을 찾아내는 데 활용된다고 밝혔다. 또한 가상 모델과 트랜잭션 레벨 플랫폼을 통해 하드웨어와 소프트웨어 개발을 병행할 수 있다고 소개하며, 아키텍처 탐색부터 실리콘 이후 검증까지 이어지는 지속적 검증 전략의 모범 사례를 제시한다.

Semiconductor Engineering2026-09-30

피지컬 AI, 엣지 반도체 설계에 실시간 제약 요구

반도체 전문지 Semiconductor Engineering이 물리적 환경에서 감지·판단·행동을 수행하는 '피지컬 AI' 시스템의 설계 원칙을 다뤘다. 이런 시스템은 중앙집중형 AI 인프라와 달리 지연시간, 전력, 열, 신뢰성, 환경 조건 등의 제약 속에서 실시간으로 동작해야 한다고 설명했다. 센서 데이터의 수집·처리·해석·행동으로 이어지는 순환 구조를 유지하려면 메모리, 연산, 통신, 입출력 자원의 예측 가능한 동작이 필요하다. 많은 피지컬 AI 시스템은 중앙 인프라에 즉시 의존할 수 없어 엣지에서 직접 실행되며, 이는 메모리 인터페이스, 인터커넥트, I/O 서브시스템, 다이 간 연결 등 실리콘 수준의 설계 결정으로 구현된다고 밝혔다.

Semiconductor Engineering2026-09-30

키사이트, 차량용 AI 검증 백서 — ADAS 안전성 평가 방법론 제시

키사이트가 자율주행·ADAS 시스템의 AI 검증을 다룬 백서를 공개했다. 인지 오류가 후속 기능으로 조용히 전파돼 안전에 영향을 줄 수 있다는 점을 지적하며, 모호한 장면·도메인 변화·희귀 엣지케이스·센서 이상 등 개방적이고 동적인 환경에서 이 위험이 커진다고 설명했다. 백서는 설명가능성, 강건성, AI 어슈어런스가 왜 필요한지와 기존 AI 검증 방식의 한계를 다룬다. 대안으로 기능·시스템·도메인 3개 계층을 아우르는 전방위적 AI 검증 접근법을 제시했다.

Semiconductor Engineering2026-09-30

인피니언 PSOC Control C3, PSU·IBC·BBU용 MCU 소개

Semiconductor Engineering이 소개한 백서에 따르면 인피니언은 AI 데이터센터 전력 설계용 PSOC Control C3 Performance Line 마이크로컨트롤러의 세부 기능을 다뤘다. GaN·SiC 전력단이 스위칭 주파수를 높이는 상황에서 PSU, 중간 버스 컨버터(IBC), 배터리 백업 유닛(BBU)의 제어 요구를 충족하도록 설계됐다. 해당 MCU는 프로그래머블 파워 컨트롤 가속기(PPCA), 25 MSPS ADC, 서브-100ps급 고해상도 PWM, 슬로프 생성 비교기, 하드웨어 3P3Z 필터, PMBus·CAN FD 인터페이스 등을 탑재했다. 인터리브 PFC·LLC 단 운용, 48V 또는 고전압 중간 버스 근접 레귤레이션, 충전·방전·오링·보호 상태 전환 등 시스템 단위 요구에 대응하는 것이 목표라고 설명했다.

Semiconductor Engineering2026-09-30

OpenAI 재퍼뇨, AI 설계 개입으로 9개월 만에 테이프아웃

AI가 EDA 툴의 개별 단계 최적화를 넘어 칩 설계 과정 자체에 관여하는 사례가 늘고 있다. 구글 딥마인드의 알파칩은 강화학습으로 TPU 3세대에 걸쳐 회로 블록 배치와 레이아웃 최적화에 쓰였고, 엔비디아는 자사 RTL과 설계 데이터를 학습한 내부 AI 모델로 GPU·가속기·CPU 개발 업무 일부를 자동화하고 있다. OpenAI는 재퍼뇨 칩 개발에서 구현, 설계공간 탐색, 검증, 산술회로 최적화 등에 AI를 직접 활용해 초기 설계부터 테이프아웃까지 9개월 만에 마쳤다고 밝혔다. 핫칩스 발표에서 OpenAI는 인간 기준 설계 대비 BF16 곱셈기 56%, FP4 내적 블록 21%, FP32 누산기 10% 성능 개선과 매트릭스·SIMD 유닛 면적 10%·8% 감소를 공개했다. 8월 말에는 아키텍트랩스가 거의 전 과정을 AI로 설계했다고 주장한 칩을 공개해 업계 첫 사례로 언급됐다.

Tom's Hardware2026-09-29