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"시놉시스"

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설계·EDA·IP

시놉시스 오토파일럿 공개, 검증·설계 자동화 에이전트 6종

시놉시스가 검증, 시스템 검증, 구현, 아날로그·혼성신호(AMS) 설계, 제조, 시뮬레이션·분석 등 6개 영역을 다루는 에이전트 포트폴리오 '에이전트엔지니어'를 새 오토파일럿 플랫폼 기반으로 공개했다. 회사에 따르면 50개 이상의 고객 참여가 진행 중이며, 정식 출시는 2026년 말로 예정돼 있다. 플랫폼은 목표를 지향하는 장기추론(long-horizon) 에이전트가 특정 작업을 수행하는 과제 에이전트를 조율하고, 과제 에이전트는 실제 작업을 실행하는 툴 계층을 활용하는 3단계 구조로 구성된다. 시놉시스 최고제품관리책임자 라비 수브라마니안은 이 기술이 기업들의 AI 보조 설계에서 자율 엔지니어링으로의 전환을 가속화한다고 말했다. 회사는 에이전트가 자율적으로 동작한다고 설명하면서도, 승인 체크포인트는 여전히 사람이 담당한다고 밝혔다.

Tom's Hardware영문 원문↗
설계·EDA·IP

지멘스EDA·시놉시스, 에이전틱 자동화 전환 — 설계 의도 연속성이 핵심

Siemens EDA, Synopsys, Arteris, Keysight EDA, Axiomise 등 EDA 업계 관계자들은 AI의 핵심 기회가 개별 툴 성능 개선보다 아키텍처·검증·구현 등 분절된 설계 단계를 아우르는 워크플로우 오케스트레이션에 있다고 진단했다. 이들은 AI가 반복적인 조정·탐색·디버깅과 툴 간 인계를 맡고, 엔지니어는 사양과 사인오프를 통제하는 '인간 주도 에이전틱 자동화' 모델이 부상하고 있다고 설명했다. Siemens EDA의 앵커 굽타 부사장은 고객들이 결과 도출 시간을 최소 2배 단축해달라고 요구한다고 전했고, Synopsys의 토마스 안데르센 부사장은 에이전틱 AI가 인간보다 비용이 더 들면 의미가 없다고 말했다. Arteris의 앤디 나이팅게일 부사장은 여러 다이와 IP 블록에 걸쳐 아키텍처 의도가 일관되게 유지되는 '시맨틱 연속성'이 파일 포맷 호환성보다 중요하다고 지적했다.

Semiconductor Engineering영문 원문
설계·EDA·IP

시놉시스 TestMAX, 칩렛 SoC 스캔 압축·RTL 시프트 레프트 지원

Semiconductor Engineering은 AI 가속기와 HPC 프로세서가 대규모 스캔 플립플롭, 칩렛 통합, 높은 테스트 커버리지 요구로 기존 DFT 방식의 한계에 직면했다고 전했다. 시놉시스는 DFTMAX SEQ 기반 TestMAX Unified Compression과 프로그래머블 고대역폭 테스트 데이터 전달망인 Streaming Fabric을 결합해 이를 해결한다고 소개했다. Unified Compression은 제조·번인·시스템레벨·필드 테스트 전반에서 재사용 가능한 압축 아키텍처를 제공하며, Streaming Fabric은 스캔 트래픽을 패킷화해 계층적 대형 설계 전반에 전달한다. 또한 TestMAX Manager를 통해 RTL 단계에서 테스트 구조를 설계하는 '시프트 레프트' 방법론도 제시됐다.

Semiconductor Engineering영문 원문
설계·EDA·IP

시놉시스 S-Litho 예측, IBM 하이-NA EUV 실리콘서 검증

시놉시스는 2021년 S-Litho 시뮬레이션으로 22nm 피치 하이-NA EUV 공정에서 수평선과 수직선의 라인엣지러프니스(LER) 차이를 약 0.3nm로 예측했다고 밝혔다. IBM이 2025년 국제 EUV 리소그래피 콘퍼런스와 2026년 Optical and EUV Nanolithography XXXIX에서 발표한 21nm 실리콘 결과는 수직선 LER 1.6nm, 수평선 LER 1.3nm로 나타나 예측된 0.3nm 차이와 일치했다. 저NA EUV에서는 수평선이 더 열악했던 경험 때문에 당시 업계와 장비업체들은 이 예측에 회의적이었으나, 하이-NA EUV에서는 배율 효과가 셰도잉 효과를 압도한다는 S-Litho의 분석이 맞아떨어졌다. 시놉시스는 이 결과가 하이-NA용 Proteus OPC 솔루션 검증에도 활용됐다고 설명했다.

Semiconductor Engineering영문 원문