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깃허브 코파일럿, 개발자 통제 유지하는 AI 에이전트 인터페이스 공개

ZDNet Korea2026-10-171분 읽기
분야 자료 사진 — 칩 다이의 회로 배치 · Martijn Boer · 퍼블릭 도메인 (기사 원문의 사진이 아닙니다)

깃허브 마틴 우드워드 개발자 관계 부문 부사장은 AI 시대의 차세대 개발자 인터페이스로 '앰비언트 인텔리전스'를 제시했다. AI 에이전트가 작업 계획과 실행, 검증을 맡고 개발자는 방향 설정과 결과 검토·통제에 집중하는 구조다. 깃허브 코파일럿 코딩 에이전트는 이슈를 받아 격리된 환경에서 작업한 뒤 결과를 풀 리퀘스트로 제출해 개발자가 반영 여부를 검토하도록 한다. 우드워드 부사장은 입력 방식(모달리티), 실행 체계(하네스), 통제 수단(컨트롤 플레인) 세 계층이 통제권을 내주지 않으면서 연결돼야 한다고 설명했다. 깃허브는 로지텍과 약 18개월간 협력해 물리 키패드로 코파일럿 세션을 호출하는 방안도 함께 소개했다.

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#깃허브#코파일럿#AI 에이전트#앰비언트 인텔리전스#소프트웨어 개발

이 글은 원문을 요약한 큐레이션입니다. 제목은 요약에 맞춰 새로 붙였습니다. 수치와 단위는 원문 표기를 유지했습니다. 전체 내용은 원 매체에서 읽어 주세요.원문: ZDNet Korea 「깃허브 "AI시대 개발 환경, 명령에서 의도로"…앰비언트 인텔리전스 제시」

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삼성디스플레이, 네오레이어 특허 5건 재심사 청구 — OLED 분쟁 확산

삼성디스플레이가 특허관리전문기업(NPE) 네오레이어가 보유한 미국 특허에 대해 미국 특허청에 결정계 재심사(EPR)를 연이어 청구했다. 9~10월 청구한 특허 3건(8,330,358·8,674,365·11,088,129)에 8월 청구분 2건을 더해 재심사 대상 특허가 총 5건으로 늘었다. 이는 네오레이어가 2025년 12월 삼성전자를 상대로 첫 특허침해소송을 제기할 때 사용한 특허 6건 중 5건에 해당한다. 네오레이어는 삼성전자 외에 고객사 에이수스, 경쟁사 BOE를 상대로도 특허소송을 진행 중이어서 이번 재심사 결과는 두 회사에도 영향을 줄 수 있다. 네오레이어가 사용한 특허는 2025년 7월 대만 AUO에서 매입한 특허 101건에 포함된 것이다.

ZDNet Korea2026-10-17

EE Times, 하드웨어 보안 검증 웨비나 공개 — 기능 검증과 별도 영역 강조

EE Times가 2026년 11월 10일 '칩이 작동한다고 해서 보안이 입증된 것은 아니다'를 주제로 한 웨비나를 연다고 밝혔다. 행사 소개에 따르면 기능 검증은 칩이 의도한 기능을 수행하는지를 확인하는 과정이고, 하드웨어 보안 검증은 이와 다른 별개의 문제를 다룬다. 구체적인 세션 내용은 원문에서 더 이어지지 않았다.

EE Times2026-10-16

Arm 피지컬AI 협력망에 가온칩스 합류, 디자인하우스 최초 참여

반도체 디자인 하우스 가온칩스가 Arm 피지컬 인공지능(AI) 종합 설계(Arm Total Design for Physical AI) 협력사로 합류했다고 15일 밝혔다. 국내 디자인 하우스 중 처음으로 이 프로그램에 참여했다. Arm 피지컬 AI 종합 설계는 Arm이 기술 협력사들과 구성한 피지컬 AI 글로벌 협력 체계로, Arm 기반 소프트웨어와 하드웨어를 통합하는 전 계층 솔루션을 공동 개발하고 검증한다. 이를 통해 로봇, 자율주행차 등 피지컬 AI 시스템의 개발 위험을 낮추고 상용화를 앞당기는 것이 목적이다.

디일렉 반도체2026-10-15

Arm AGI CPU, 에이전틱AI용 랙 성능지표로 AMD와 비교

영국 Arm이 에이전틱 인공지능(AI) 작업 부하에 맞춘 신규 CPU 성능 측정 체계를 공개했다고 15일 밝혔다. 이 체계는 후지쯔, 메타, 오픈AI의 지원을 받아 만들어졌으며, 개별 칩이 아닌 랙 단위로 전체 연산 과정의 성능을 검증하는 데 쓰인다. Arm은 이를 이용해 자사 AGI CPU와 AMD 서버용 에픽 5세대 튜린 9755 CPU를 비교한 결과, 랙당 작업 처리량이 약 2배 높았다고 주장했다. 해당 측정은 Arm의 의뢰로 분석업체 시그널65가 수행했으며, AGI CPU는 Arm이 3월 공개한 첫 자체 설계 CPU다.

디일렉 반도체2026-10-15

PCIe 리타이머 전송거리, SerDes와 컨트롤러 설계가 결정

PCIe 리타이머가 신호를 얼마나 멀리 전송할 수 있는지는 PCI-SIG 규격 준수 여부만으로 정해지지 않는다. 규격은 나이퀴스트 주파수에서 약 36dB의 삽입 손실 허용을 요구하지만, 주요 리타이머는 등화 회로와 클록 복구 알고리즘을 통해 40dB 이상의 손실도 견디도록 설계된다. 또한 온도·전압 변화, 공정 편차 등 실제 환경에서 코너케이스를 처리하는 컨트롤러의 지능, 링크 트레이닝·오류 통계 등을 보여주는 진단 기능, PCB 소재·임피던스·커넥터 품질 같은 채널 설계 전반이 실질적인 전송 거리를 좌우한다는 설명이다.

Semiconductor Engineering2026-10-15

비아 삽입 자동화 EDA, 5nm 이하 인터커넥트 신뢰성 강화

반도체 업계는 5nm 이하 공정에서 게이트 지연보다 인터커넥트 성능이 설계 품질을 좌우하는 상황을 맞고 있다. 금속층을 연결하는 비아는 치수가 작아질수록 저항이 급격히 커져 전자이동(EM)과 IR 드롭 문제를 심화시킨다. 기존에는 신호 경로와 파워 그리드에 수동으로 중복 비아를 추가해 대응했지만, 최신 공정의 레이아웃 밀도와 파운드리 설계 규칙 복잡성 때문에 수동 삽입이 현실적으로 불가능해졌다. 이에 따라 구현 단계에서 사인오프 품질 엔진을 활용해 중복 비아 삽입 위치를 자동으로 찾아내는 '시프트 레프트' 방식이 제안되고 있으며, 레이아웃이 불완전한 상태에서도 동작하는 '쇼트 레질리언트' 기능도 포함된다.

Semiconductor Engineering2026-10-15

UCIe·칩렛 개방형 표준, AI 인프라 설계 유연성 좌우

반도체 업계 매체 Semiconductor Engineering은 AI 학습과 추론이 메모리·연결·패키징에 서로 다른 요구를 갖기 때문에 단일 아키텍처로는 모든 워크로드에 대응하기 어렵다고 설명했다. 이에 따라 UCIe 같은 개방형 표준이 다이 간 연결을 표준화해 칩렛 기반 설계에서 서로 다른 공급사·파운드리의 기능을 한 패키지에 통합할 수 있게 해준다고 전했다. 또한 PCIe, CXL, UALink, 이더넷, 224G SerDes 등 서로 다른 연결 기술과 HBM4E, LPDDR6 같은 메모리가 시스템 내 각기 다른 역할을 맡는다고 설명했다. 기사는 이러한 개방형 인터페이스와 상호운용성이 향후 워크로드 변화에 대응할 설계 유연성을 제공한다고 밝혔다.

Semiconductor Engineering2026-10-15

AMBA C2C 등장, AXI·CHI 아우르는 칩렛 연결 표준으로 진화

Arm은 칩렛 간 연결을 위한 새로운 사양 AMBA C2C를 개발 중이라고 밝혔다. AMBA C2C는 2023년 공개된 AMBA CHI C2C를 기반으로 하며, AXI와 CHI를 포함한 AMBA 프로토콜 전반을 하나의 통합된 칩투칩(C2C) 연결 방식으로 아우른다. 프로토콜 서브셋을 정의해 디바이스·가속기 연결 같은 단순한 용도부터 완전한 코히런트 이종 컴퓨팅 시스템까지 기능과 구현 복잡도를 확장할 수 있도록 했다. 전송 계층은 프로토콜과 분리되는 계층적 구조를 따르며, UCIe 스트리밍 등 다양한 다이투다이 전송 방식과 함께 사용할 수 있다. Arm은 이 사양을 업계와 협력해 개발 중이며, 기존 AMBA와 마찬가지로 무상·로열티 프리·아키텍처 중립 방식으로 공개할 계획이라고 설명했다.

Semiconductor Engineering2026-10-15